小马Ti的博客

奇偶校验码定义奇偶校验码（Parity Check Code）是一种简单的错误检测码，用于检测数据传输或存储过程中是否发生了错误。 组成部分1.数据位：原始的数据位。 2.校验位：附加在数据位后面的一个位，用于实现奇偶校验。 结构形式奇偶校验码通过在数据位后面添加一个校验位来实现。校验位可以是奇校验或偶校验，确保整个数据（包括校验位）中1的个数是奇数（奇校验）或偶数（偶校验）。 分类1.奇校验：确保整个数据中1的个数是奇数。 2.偶校验：确保整个数据中1的个数是偶数。 基本原理（硬件）1.求偶校验位 2.进行偶校验 验码 定义奇偶校验码（Parity Check...

多模块存储器定义多模块存储器（Multi-Module Memory）是一种由多个独立存储模块组成的存储系统，每个模块都可以独立访问，提高了数据访问的速度和带宽。 分类1.多体并行存储器 2.单体多字存储器 组成部分1.存储模块构成多模块存储器的基本单元，每个模块都是一个独立的存储单元。 2.控制器用于管理多个模块之间的数据分配和同步。 3.数据总线用于在模块之间传输数据。 结构形式多模块存储器通常以多个存储芯片或模块的形式存在，它们可以通过并行或串行方式连接。 特征高速度，高带宽，可扩展性，用于需要大量数据存储和高性能计算的应用。储器 定义多模块存储器（Multi-Module...

多处理器系统的基本概念SISD SIMD MISD不存在 MIMD1. 2.多计算机系统 向量处理器 相关知识点 概念 SISD SIMD MISD不存在 MIMD1. 2.多计算机系统 向量处理器 相关知识点 # 多处理器系统的基本概念 SISD SIMD MISD不存在 MIMD1. 2.多计算机系统 向量处理器 相关知识点 概念 SISD SIMD MISD不存在 MIMD1. 2.多计算机系统 向量处理器 相关知识点

多体并行存储器结构形式 使用方法1.取几个体？ 储器 结构形式 使用方法1.取几个体？ # 多体并行存储器 结构形式 使用方法1.取几个体？ 储器 结构形式 使用方法1.取几个体？

SSD定义SSD（Solid State Drive，固态驱动器）是一种基于闪存存储技术的非机械存储设备。它通过使用NAND闪存或DRAM等存储介质来存储数据，不包含传统硬盘驱动器中的机械部件。 组成部分1.NAND闪存芯片用于存储数据的主要存储介质。 2.控制器管理数据的读写操作、数据分配和垃圾回收等功能。 3.缓存通常是DRAM，用于加速数据读写操作。 4.接口如SATA、NVMe，用于与计算机系统连接和通信。 结构形式1.单级单元（SLC）每个存储单元存储1位数据，速度快、寿命长。 2.多级单元（MLC）每个存储单元存储2位数据，成本较低但寿命和速度相对较低。 3.三级单元（TLC）每个存储单元存储3位数据，成本更低，但寿命和速度进一步降低。 4.四级单元（QLC）每个存储单元存储4位数据，提供最高密度但寿命和速度最短。 分类1.SATA SSD：使用SATA接口，适用于较旧的计算机系统，速度受SATA接口限制。2.NVMe...

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ROM定义ROM（Read-Only Memory，唯读存储器）是一种只能读取不能写入的非易失性存储器，用于永久性地存储固件或不可变数据。数据在制造时或通过专用程序写入后，不能被修改或擦除。 结构形式ROM通常以集成电路的形式存在，其数据在制造过程中被永久性地编程。 分类1.包括掩模ROM（MROM） 2.可编程ROM（PROM） 3.可擦写可编程ROM（EPROM） 4.电可擦写可编程ROM（EEPROM） 5.闪存FM（Flash Memory） 6.SSD（Solid State Drive） 特征只读，非易失性（断电后数据不丢失），速度较RAM慢。 相关知识点 OM 定义ROM（Read-Only...

双端口RAM定义双端口RAM（Dual-Port RAM）是一种特殊的随机存取存储器，它具有两个独立的访问端口，允许同时从两个不同的源进行读写操作。 组成部分1.存储单元：构成RAM的基本单元，每个单元存储一个数据位。 2.两个独立的端口：每个端口都有自己的地址线、数据线和控制线。 3.控制逻辑：用于管理两个端口的数据访问和同步。 结构形式双端口RAM通常以集成电路的形式存在，其内部结构设计为允许同时访问。 特征同时访问能力，高速度，用于需要并行处理的应用。AM 定义双端口RAM（Dual-Port RAM）是一种特殊的随机存取存储器，它具有两个独立的访问端口，允许同时从两个不同的源进行读写操作。 组成部分1.存储单元：构成RAM的基本单元，每个单元存储一个数据位。 2.两个独立的端口：每个端口都有自己的地址线、数据线和控制线。 3.控制逻辑：用于管理两个端口的数据访问和同步。 结构形式双端口RAM通常以集成电路的形式存在，其内部结构设计为允许同时访问。 特征同时访问能力，高速度，用于需要并行处理的应用。# 双端口RAM 定义双端口RAM（Dual-Port...

原码除法（通过补码来实现的）基本原理 最后一步，如果MQ的最后一位是1，那么还要加一次除数。 使用方法恢复余数法1.符号位单独处理2.数值位计算 加减交替法（不恢复余数法，即上一个的优化版本）的） 基本原理 最后一步，如果MQ的最后一位是1，那么还要加一次除数。 使用方法恢复余数法1.符号位单独处理2.数值位计算 加减交替法（不恢复余数法，即上一个的优化版本）# 原码除法（通过补码来实现的） 基本原理 最后一步，如果MQ的最后一位是1，那么还要加一次除数。 使用方法恢复余数法1.符号位单独处理2.数值位计算 加减交替法（不恢复余数法，即上一个的优化版本）的） 基本原理 最后一步，如果MQ的最后一位是1，那么还要加一次除数。 使用方法恢复余数法1.符号位单独处理2.数值位计算 加减交替法（不恢复余数法，即上一个的优化版本）

原码乘法原码一位乘基本原理 ACC存储乘积的高位。 MQ存储乘积的低位。 使用方法 符号位：符号位单独处理，用两个符号的异或结果处理。 数值位：数值位取绝对值进行乘法计算。 PS： 1.原码乘法通过逻辑右移实现。 当MQ最后一位是0，则加0；是1，则加被乘数绝对值的原码 2.最后的结果需要通过ACC和MQ的内容进行拼接。乘法 原码一位乘基本原理 ACC存储乘积的高位。 MQ存储乘积的低位。 使用方法 符号位：符号位单独处理，用两个符号的异或结果处理。 数值位：数值位取绝对值进行乘法计算。 PS： 1.原码乘法通过逻辑右移实现。 当MQ最后一位是0，则加0；是1，则加被乘数绝对值的原码 2.最后的结果需要通过ACC和MQ的内容进行拼接。#...